Electronique - Débogueur de conception de FPGA




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Débogueur de conception de FPGA
[ CAO ]
Débogueur de conception de FPGA
Identify 2.2 de Synplicity

La rédaction , Electronique International, le 20/12/2005 à 07h00

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Cet outil de débogage de conceptions de FPGA permet d'annoter le code RTL en vue du débogage de la conception à vitesse réelle (une fois la synthèse réalisée)

Support des langages VHDL et Verilog (mixés dans un même projet)

Gestion des déclenchements croisés entre plusieurs émulateurs In Circuit embarqués sur le FPGA

Support de l'équivalence des signaux (analyse des signaux issus de l'instrumentation embarqués à travers les différents niveaux hiérarchiques de la conception)

Support des familles Stratix II d'Altera

Rens. : 04 88 71 88 66




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